Translation lookaside buffer

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TLB (do inglês Translation Lookaside Buffer) é um dispositivo de hardware implementado a partir de uma pequena memória associativa que fica integrada na Unidade de Gestão de Memória de um processador. Destina-se a facilitar a tradução de endereços lineares em endereços físicos, evitando a consulta à tabela de páginas localizada na memória.

Tal como uma cache de memória mantém uma cópia dos dados acedidos mais recentemente, um TLB mantém uma cópia dos endereços físicos das frames de memória acedidas mais recentemente.

Quando um endereço é solicitado, o processador verifica se o endereço da frame respectiva existe no TLB. Se este for encontrado, é utilizado para gerar o endereço físico pretendido e o acesso à memória é iniciado. Em caso de falha, a tabela de páginas será consultada. Os projetistas observaram que os processos tendem a acessar com mais freqüência um número reduzido de páginas virtuais. Isto permite obter taxas de sucesso próximas de 100%, mesmo com TLBs de dimensões reduzidas.

O TLB incluído no processdor Intel i486DX era constituído por uma memória associativa em grupos de 4 vias com 32 posições.

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